생체계측과제#12 8조 1등 조진호 2등 차송희 3등 조은진

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1 생체계측과제#12 8조 1등2004200467 조진호 2등2007101329 차송희 3등2007102860 조은진
4등 조정민 5등 진선웅

2 Electrical Safty P=v*i, w=∫pdt 저항에서 전류 발생 손실 발생을 줄이기 위해 승압을 시킨다
i v 10,000V Earth P=v*i, w=∫pdt 저항에서 전류 발생 손실 발생을 줄이기 위해 승압을 시킨다 전류는 폐회로를 구성해야 한다 인처에 영향을 주는 것 -> 전류!

3 발전소에서… “Faraday Induction” V ∝dΦ/dt R = L/(σs)

4 Ground Earth Ground - 땅에서 부터 기준을 잡음 - 저항이 같을 때 전압이 낮으면 안전 Signal Ground - Floating 되어 있음 - Earth와는 전혀 상관 없음 - 물리적으로 도체를 연결해야 같다

5 Let go current 전류가 증가 -> Resting membrane potential 증가 -> threshould 증가 -> 감각, 운동신경 자극 -> 근육자극( 근육 수축) 전류가 몸에 흐르고 있을 때 자기 의사대로 손을 놓을 수 있는 전류의 량

6 의료기기를 만들 때 고려해야 하는 사항 환자의 몸에 220V가 연결이 된다는 것 가정 + Vcc, iso 220V Amp
ADC Mp LCD Flat metal frame Floating 된 배터리를 공급하여 외부 전류를 막는다. +Vcc, iso -> Isolation

7 설계1 Isolation Barrier +V +VISO 변조기 ADC MP -VISO -V 변조기 Display I/O
심전도 증폭기 변조기 변조기 ADC MP I/O -VISO -V November 16, 2018 CSA & VLSI Lab.

8 전원부 Step down Transformer Isolation Transformer LPF +V -V
60Hz Isolation Transformer Step down Transformer Regulator LPF Bridge Diode +V -V November 16, 2018 CSA & VLSI Lab.

9 ★설계1 의 특징 설계1의 특징 잘 사용되지 않는다. 자장을 이용한 변조기 때문에 신호의 왜곡이 발생할 수 있다.
저렴 하게 쓰인다. November 16, 2018 CSA & VLSI Lab.

10 설계2 Isolation Barrier +V +VISO MP MP -V -VISO ADC Display I/O
심전도 증폭기 ADC MP 광결합기 MP Display 광결합기 I/O -VISO -V November 16, 2018 CSA & VLSI Lab.

11 전원부 Step down Transformer Isolation Transformer LPF LPF +V -V +VISO
Regulator LPF Bridge Diode +V -V 220V 60Hz Regulator LPF Bridge Diode +VISO -VISO Isolation Transformer November 16, 2018 CSA & VLSI Lab.

12 광결합기& 설계2의 특징. ★설계2 의 특징 가장 많이 사용한다. 신호의 왜곡을 최소화 두 개의 MP를 이용하여
TxD RxD +V LED Photo TR ★설계2 의 특징 가장 많이 사용한다. 신호의 왜곡을 최소화 두 개의 MP를 이용하여 DSP 기능을 분담처리 가능 Optically Isolated Full Dupler Serial Communication +V TxD RxD LED Photo TR November 16, 2018 CSA & VLSI Lab.

13 설계3 Isolation Barrier +VISO +V MP CPU -VISO -V ADC Display
심전도 증폭기 ADC MP 광결합기 CPU COMMUNICATION 광결합기 I/O -VISO -V November 16, 2018 CSA & VLSI Lab.

14 ★설계3 의 특징 설계3의 특징 휴대성이 있다. BATTERY를 이용해야 하기 때문에 저전력 설계를 고려해야 한다.
November 16, 2018 CSA & VLSI Lab.